与非门的逻辑功能是：只有所有输入为高电平时输出才为高电平。（)

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发布时间：2022-12-05

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第1题

或门的逻辑功能是：当有一个或一个以上的输入为高电平时，输出就为高电平。（)

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第2题

图10.18为一个左移位寄存器，在下侧加一个组合逻辑电路（与非门G1，G2，G3和G4)。数码由D端经组合逻辑电路送至最

图10.18为一个左移位寄存器，在下侧加一个组合逻辑电路(与非门G₁，G₂，G₃和G₄)。数码由D端经组合逻辑电路送至最低位触发器输入端 D₀。X为控制端。试分析当X＝0和X＝1时，电路的逻辑功能。

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第3题

电路如下图（a)所示，其中G0，G1，G2，…，GN为TTL同系列与非门，它们的输入特性和输出特性分别如下图（b)、（c)和（d)

电路如下图(a)所示，其中G₀，G₁，G₂，…，G_N为TTL同系列与非门，它们的输入特性和输出特性分别如下图(b)、(c)和(d)所示。受功耗的限制，规定高电平输出电流不能超过400μA。已知G₀的输出电平满足V_oH≥3.2V，V_oL≤0.25V。问G₀最多可以驱动多少个负载门？

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第4题

将TTL与非门作非门使用，则多余输入端应做()处理。

A.部分接高电平，部分接地

B.部分接地，部分悬空

C.全部接高电平

D.全部接地

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第5题

当TTL与非门的输入端悬空时相当于输入为（)

A.逻辑0

B.逻辑1

C.不确定

D. 0.5v

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第6题

已知Z1的逻辑函数式为Z1（4，B，C，D)=∑m（0，2，4，9，11，13，15)，将其用最少两输入与非门实现之。

已知Z₁的逻辑函数式为Z₁(4，B，C，D)=∑m(0，2，4，9，11，13，15)，将其用最少两输入与非门实现之。

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第7题

如果将TTL与非门作非门使用，则多余输入端应做（）处理。 A．全部接高电平 B．部分接高电平，部分接地 C．全部接地 D．部分接地，部分悬空

A.部分接高电平，部分接地

B.全部接高电平

C.部分接地，部分悬空

D.全部接地

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第8题

CMOS施密特与非门组成的电路如图7．3．3（a)所示，窄脉冲触发输入信号vI如图7．3．3（b)所示。已知R=5 kΩ

CMOS施密特与非门组成的电路如图7．3．3(a)所示，窄脉冲触发输入信号vI如图7．3．3(b)所示。已知R=5 kΩ，C=0．1μ F，VDD=5 V， VOH≈5 V，VILL≈0 V，VT+=3．3 V，VT-=1．8 V。 (1)分析电路的工作原理，画出vV及vO的波形(两个触发脉冲间隔的时间足够长)。 (2)计算输出高电平持续的时间。