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[主观题]
试设计一个脉冲序列发生电路，在CP的作用下，要求电路的输出F端能周期性地输出1100010101的脉冲序列。
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第2题
试用PLA和D触发器设计一个具有以下逻辑功能的电路，并画出PLA阵列图。
①当M=0时，D4D3D2D1=ABCD
②当M=1时，D4=Q3、D3=Q2、D2=Q1、D1=0在CP作用下实现左移操作。
第4题
图8.2.1(a)所示为产生宽度等于12个CP周期的脉冲产生器，试选择MSI计数器设计控制电路，并画出电路的工作波形。
第7题
图8．2．1(a)所示为产生宽度等于1 2个CP周期的脉冲产生器，试选择MSI计数器设计控制电路，并画出电路的工作波形。
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第9题
图是一个序列信号产生电路，由一个计数器和一个PLA组成，(PLA组成的电路是一个数据选择器)，CP是方波时钟信号。试画出QA～QD和f信号的波形(要求超过一个计数周期)。
第10题
设一个二进制D/A转换器的满刻度输出电压Vom为8V，实验电路框图如下图所示，图中计数器由JK触发器构成，试对应于时钟信号10个CP脉冲画出输出电压波形(设触发器的初始状态为0000) 。
第11题
在图Ⅲ-10所示电路中，CP脉冲到来前先清零。试画出Q1、
