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[主观题]

试在表3-4中选用一片适当的集成芯片实现。 表3-4 部分门电路及其传输延迟时间

试在表3-4中选用一片适当的集成芯片实现试在表3-4中选用一片适当的集成芯片实现。            表3-4 部分门电路及其传输延迟时

表3-4 部分门电路及其传输延迟时间

型号

名称

tpd/ns

型号

名称

tpd/ns

74S00

四2输入与非门

3

74LS27

三3输入与非门

10

7400

四2输入与非门

10

74S30

8输入与非门

5

74S02

四2输入或非门(OC)

3.5

74S32

四2输入或门

4

74S03

四2输入与非门(OC)

5

74S51

双2路2-2输入或非门

3.5

74LS04

六反相器

10

7454

4路2-2-2-2输入与或非门

10.5

74S05

六反相器(OC)

5

74LS55

2路4-4输入与或非门

12

74S08

四2输入与门

5

74S64

4路4-2-3-2输入与或非门

3.5

74S10

三3输入与非门

3

74S86

四2输入异或门

7

74S11

三3输入与门

5

74LS125

4总线缓冲器(3S)

8

74LS12

三3输入与非门(OC)

16

74LS126

四总线缓冲器(3S)

9

74LS20

双4输入与非门

3

74S135

四异或/异或非门

10

74S22

双4输入与非门(OC)

5

74LS244

八缓冲器/线驱动器/线接受器(3S,两组控制)

12

7425

双4输入或非门(有选通)

11

74LS245

八双向总线发送器/接收器(3S)

8

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图(a)是AD7243逻辑框图,它是一种可供用户由单极性扩展为双极性的DAC集成芯片,单极性输出为0→+10V,请读者增加适当的引脚连接线,使之成为-5V→+5V双极性输出的DAC,并说明理由。

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图6-20(a)是AD 7243逻辑框图,它是一种可供用户由单极性扩展为双极性的DAC集成芯片,单极性输出为0→+10V,请读者增加适当的引脚连接线,使之成为一5V→+5V双极性输出的DAC,并说明理由。

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试选用中规模集成电路实现表4-15所示电路。

表4-15真值表

ABCDF1F2F3
0

0

0

0

0

0

0

0

1

1

1

1

1

0

0

0

0

1

1

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1

1

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0

0

0

0

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0

0

0

0

0

0

0

1

1

1

1

1

1

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8086芯片中集成有高速缓冲存储器。( )

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