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[主观题]
图8.2.3所示的为某时序电路的框图和输入X与输出F1~F4关系的波形图,试设计该电路。
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第3题
设CPLD中某宏单元编程后电路如下图所示,图中画出了S1~S8和M1、M3编程后的连接。数据分配器S1~S8未被选中的输出为0。已知各乘积项如下图中所示。
第5题
图所示为某钢材在不同循环特征r下的σ-N曲线,如材料的强度极限σb为已知。试在σm-σa坐标系中示意标出不同r的坐标点和绘出持久极限曲线。
第6题
图中所示为一种集成串/并行型ADC,请分析该框图,回答下列问题:
(1)串行级数;
(2)计算输出位数公式。
第7题
图6-20(a)是AD 7243逻辑框图,它是一种可供用户由单极性扩展为双极性的DAC集成芯片,单极性输出为0→+10V,请读者增加适当的引脚连接线,使之成为一5V→+5V双极性输出的DAC,并说明理由。
第8题
第10题
已知美国HDTV地面广播发送端数字处理框图及数据成帧结构如图6.2.4所示,抽样频率之比为Y:R-Y:B-Y=8:1:1,数据结构Y为1408×960,R-Y为352×480,B-Y为352×480,R-S纠错为207B中有187B有用信息。