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[主观题]

CPU在总线周期中插入TW等待周期的个数取决于（)

A、“READY”信号

B、随机

C、主频

D、时钟周期

答案

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发布时间：2022-12-04

更多“CPU在总线周期中插入TW等待周期的个数取决于（)”相关的问题

第1题

8086处理器的一个总线周期中插入Tw是在（）

A.T1之后

B.T2之后

C.T3之后

D.T4之后

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第2题

8086CPU在读/写总线周期的T3状态结束对READY线采样,如果READY为低电平,则在T3与T4状态之间插入等待状态TW( )。

8086CPU在读/写总线周期的T3状态结束对READY线采样,如果READY为低电平,则在T3与T4状态之间插入等待状态TW（)。

8086CPU在读/写总线周期的T3状态结束对READY线采样,如果READY为低电平,则在T3与T4状态之间插入等待状态TW()。

A、错误

B、正确

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第3题

假设某系统总线在一个总线周期中并行传输4字节的信息，一个总线周期占用2个时钟周期，总线时钟频率为10MHz，则总线带宽是（)

A.10MB/s

B.20MB/s

C.40MB/s

D.80MB/s

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第4题

假设不采用Cache 和指令预取技术,且机器处于“开中断”状态,则在下列有关指令执行的叙述中,正确的是（）

A.每个指令周期中CPU 都至少访问内存一次

B.每个指令周期一定大于或等于一个CPU 时钟周期

C.空操作指令的指令周期中任何寄存器的内容都不会被改变

D.当前程序在每条指令执行结束时都可能被外部中断打断

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第5题

假定在CPU和主存之间有一个同步总线相连，其时钟周期为50 ns，单独设有32位地址线和32位数据线。主

存读传输时，首先要花1个时钟周期发送地址和读命令，最终从总线取数要花一个时钟周期，存储器的取数时间为220 ns；主存写操作时，先花一个时钟周期送地址、数据和写命令，在随后的两个时钟周期内写人数据。要求分别求出该存储器进行连续读和写操作时的总线带宽。

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第6题

等待状态TW应在（)之间插入。

A.T1和T2

B.T3和T2

C.T3和T4

D.T4和T1

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第7题

8086 CPU读数据操作在总线周期的（)时刻。

A.T3，T4

B.T2，T3

C.T1，T2

D.T1

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第8题

8086CPU在允许中断状态下，若INTR=1，则CPU在()之后，响应中断请求。

A.完成当前时钟周期

B.完成当前指令周期

C.完成当前总线周期

D.取得当前指令的操作码

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第9题

元素周期表中共有______个周期。在同一周期中，从左到右，元素的金属性逐渐______，非金属性逐渐______。

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第10题

当8086与外设交换数据时，常会在（)进入等待周期Tw。

A.T1与T2之间

B.T2与T3之间

C.T3与T4之间

D.T4与T1之间

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第11题

若CPU要读取主存单元中的内容，那么在取得总线控制权后，CPU将在第一个时钟周期内通过总线向主存发

送()。 I．“主存读”控制信号 Ⅱ．“地址”信息 Ⅲ．“应答(ACK)”控制信号

A．Ⅰ

B．Ⅱ

C．Ⅲ

D．Ⅰ、Ⅱ

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