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[单选题]

在Verilog HDL的设计模块中,一般用( )型变量来定义硬件电路中的各种物理连线。

A.register

B.nets

C.register或nets

D.integer

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更多“在Verilog HDL的设计模块中,一般用()型变量来定义硬件电路中的各种物理连线。 A.register B.nets C.reg”相关的问题

第1题

Verilog HDL的功能描述是用来描述设计模块的______和模块端口间的______。
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第2题

Verilog HDL的功能描述可以用______、______、______和______等方法来实现,通常把确定这些设计模块描述的方法
称为建模。
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第3题

Verilog HDL的设计模块可以被高层次的系统( ),成为系统的一部分。

A.输入

B.输出

C.仿真

D.调用

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第4题

在基于Verilog HDL的触发器的设计中,能够实现上升沿触发器关键字是( )。

A.posedge

B.negedge

C.notif0

D.notif1

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第5题

Verilog HDL的信号类型声明用来声明设计电路的功能描述中所用的信号的______和______。
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第6题

用Verilog HDL设计门电路时,可以采用______建模和______建模的方法来描述。
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第7题

在Verilog HDL中,赋值语句有______、______、______和______4种。
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第8题

在Verilog HDL的关系运算中,如果关系是真,则计算结果为( )。

A.0

B.1

C.x

D.z

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第9题

Verilog HDL于______推出,是在______的基础上演化而来的。
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第10题

Verilog HDL的常量是一个恒定不变的值数,一般在______定义。
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第11题

Verilog HDL中的常量主要有:整数,实数和字符串。()
Verilog HDL中的常量主要有:整数,实数和字符串。()

A.正确

B.错误

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