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利用可编程逻辑器件设计实现4位二进制并行加法器。
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第5题
现欲构成一个并行二进制原码A到它的补码B的转换电路。该电路采用了如下算法：
试设计一个积木块，并用以构成上述转换电路。
第6题
设输入数据序列为X(i)，每个X(i)数据是8位无符号二进制数(并行码)。X(i)为串行同步序列，即每时钟clk的上升沿时输入一个数据。试用VHDL实现以下滤波运算，得到滤波输出yout。运算中的乘、除可用移位直接实现。
yout(n)=X(n)+2*X(n-1)+0.5*X(n-2)+0.25*X(n-3)
第8题
试设计一个时序电路，将16字×4位的ROM中的数据变为串行码，并自动循环输出。(建议：用555，'161和'194等实现。)
第9题
A.错误
B.正确
